图像处理算法IP核的异构验证框架

赵陆; 文建平; 莫为; 陈仕睿; 李项河

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图像处理算法IP核的验证是SoC和FPGA在机器视觉领域应用的关键.为了提高验证时效性,本文基于ARM+ FPGA异构平台,联合上位机软件,针对图像处理算法IP核设计了一种兼具泛用型、实时性和敏捷性的验证框架.验证框架通过ARM处理器与上位机建立千兆以太网通信,实现测试激励和测试响应的实时传输,使用FPGA以兼容多类型不同分辨率的图像为目的构建数据总线,配置总线和处理模块,并结合部分重配置实现待验证算法IP核的快速迭代.实验结果表明:验证框架对于以8,16,24 bit位深度图像为处理对象和结果的算法IP核具有可重用性,待验证IP核的部署速度相对全局重配置提高了25倍.与现有的FPGA验证技术相比,具有更好的可重用性,更短的验证周期,并且测试激励更具有针对性,待验证IP核的部署更加敏捷快速.

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来源
《液晶与显示》 |2021年第7期|1042-1050|共9页
作者
赵陆; 文建平; 莫为; 陈仕睿; 李项河;
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作者单位

西安科技大学机械工程学院陕西西安710054;

西安科技大学机械工程学院陕西西安710054;

陕西科技控股集团有限责任公司陕西西安710000;

西安西微智能科技有限公司陕西西安710000;

西安科技大学机械工程学院陕西西安710054;

西安科技大学机械工程学院陕西西安710054;

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原文格式 PDF
正文语种 chi
中图分类信息处理（信息加工）;专用集成电路;
关键词
FPGA原型验证; 异构架构; 图像处理算法IP核; 部分重配置;

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